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Exemple des emplois de Joël,
freelance MODELSIM résidant dans l'Eure (27)

  • - Organisation d&#x2019événements, de salons professionnels, lancement de nouveaux produits. Gestion d&#x2019un budget annuel de 150 K &#x20AC.
    Jan 2021 - Jan 2025

    Développement d&#x2019un prototype 4G au format LTE et un prototype 5G sur une carte
    FPGA xilinx ZCU102 avec composant zinc utralscale+
    Et utilisant la technologie CPRI et ECPRI
    Réalisation d&#x2019une carte à base d&#x2019un Fpga xilinx

    Environnement Technique : Modelsim, Synplify premier, Vivado 2021.2 Mathlab 2021, hdlcoder
  • Eolane Monbonnot Isère
    Jan 2019 - Jan 2021

  • JC Decaux Plaisir 78
    Jan 2019 - Jan 2019

    Développement d&#x2019un FPGA Lattice pour le traitement d&#x2019affichage Vidéo
    Suivant la norme RVB, le dialogue étant fait sur une convexion USB 3.0
    L&#x2019ensemble développé en VHDL, et simulé avec Modelsim

    Environnement Technique : Modelsim, Diamond 3.10
  • E-blink Boussy saint Antoine
    Jan 2017 - Jan 2018

    Reprise d&#x2019une carte a base d&#x2019un Fpga xilinx kintex pour un produit traitent internet 4G
    Avec des émetteurs récepteurs utilisant la technologie LTE

    J&#x2019ai eu en charge de reprendre l&#x2019ensemble du produit, du fait que l&#x2019équipe ayant développé le produit n&#x2019était plus dans la société, et aucune documentation n&#x2019avait été produite

    La FPGA xilinx a été développée sous ise 13.2, j&#x2019ai repris l&#x2019ensemble des module vhdl et porté sous Vivado 2016.4 en corrigent certain module, génération de nouveau module Vhdl, et vérilog
    Ecriture d&#x2019une documentation

    Environnement Technique : Modelsim, Synplify premier, Vivado 2016.4 Mathlab 2017.b, hdlcoder
  • Eolane Monbonnot Isère
    Jan 2014 - Jan 2017

    Développement d&#x2019une carte Ethernet Gbits a base d&#x2019une FPGA ZYNQ 7030
    J&#x2019ai eu la charge de développer le FPGA en VHDL et en Verilog
    Et simuler l&#x2019ensemble avec modelsim et Questasim
    Cette carte intègre les fonctions de filtrage, pour cette carte j&#x2019ai développé la fonction Qos.
    Pour ce développement j&#x2019ai eu la responsabilité de l&#x2019ensemble du produit
    En tant que chef de projet d&#x2019une équipe de 6 personnes, et expert en FPGA
    Pour la partie logicielle j&#x2019ai développé un module de test pour le processeur cortex A9

    Environnement Technique : Modelsim, Synplify premier, vivado composant zynq, petalinux
  • Modernisation du projet fait
    2014 - aujourd'hui

  • ANSALDO - Les Ulis
    Jan 2011 - Jan 2014

    Projet BTM, et Diva2G

    Développement d&#x2019interface sur deux FPGA xilinx et Altéra d&#x2019un système de traitement de signal pour un système de détection de balise pour les chemins de fer (SNCF)
    Pour ce développement j&#x2019ai eu la charge de définir est développer le contenu des deux FPGA en VHDL
    Et de simuler l&#x2019ensemble sur Modelsim
    Pour Diva2g utilisation de composant Zynq et du logiciel Vivado
    Dans le cadre d&#x2019une nouvelle carte de gestion ferroviaire

    Environnement Technique : Quartus, ISE, Modelsim, Synplify, Matlab Simulink vivado composant zynq
  • VALEO Créteil
    Jan 2010 - Jan 2011

    Développement d&#x2019un système de pilotage de moteur électrique triphasé à base d&#x2019un microcontrôleur MPC 5643L et de deux FPGA ACTEL
    Pour ce développement j&#x2019ai la charge de défini l&#x2019architecture du système (rédaction des documents en anglais)
    Et de développer sur les fpga l&#x2019interfaçage entre le microcontrôleur et les FPGA dialogue SPI, la gestion des PWM, et un traitement numérique (interpolation, décimation)

    Environnement Technique : Libero FPGA, PSPICE, Modelsim, Synplify
  • VALEO Thermique Habitacle et moteur
    Jan 2010 - Jan 2010

    Validation d'une modification sur un module électronique :

    Pilotage de moteur DC 400W par commande linéaire avec Mos en « Ballast ». Asservissements en courant et tension.
    La modification principale est un changement de référence et de fournisseur MOSFET sur la cellule de puissance.
    &#xF0D8 écriture des plans de test électriques, CEM, thermique
    &#xF0D8 réalisation de certains essais internes
    &#xF0D8 suivi des essais auprès de labos externes (CEM)
    &#xF0D8 écriture/validation des rapports d'essais
    &#xF0D8 mise à jour du dossier de justification de conception

    Environnement Technique : PADS, PSPICE
  • HISPANO-SUIZA&#x2013 REAU
    Jan 2009 - Jan 2010

    Projets EBMA-EMCU

    &#xF0D8 Analyse des dossiers du boîtier électronique du boîtier EMCU système de commande train atterrissage suivant la norme DO160D et AMD24C
    &#xF0D8 Reprise des dossiers pour que le boîtier de commande passe en zone foudre
    &#xF0D8 Modifications du schéma électronique + implantation de diode transil puis suivi du maquettage de cette solution
    &#xF0D8 Sur l&#x2019ensemble des dossiers EBMA-EMCU reprise des exigences de traçabilité sous Excel portage de ces informations sous Doors.
    &#xF0D8 Création d&#x2019une base de données en tant qu&#x2019administrateur puis modification des documents pour permettre le portage de la matrice de traçabilité.
    &#xF0D8 Suivi des modifications sur les cartes électronique avec le groupe Sagem à Valence.

    Environnement Technique : DOORS
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